掲示板一覧 - トピック一覧 SysML 他の内部ブロック図に勝手にportが追加されてしまう |
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umesan | 投稿日時: 2022-8-10 14:05 |
EA Administrator 投稿: 1526 |
他の内部ブロック図に勝手にportが追加されてしまうサポート宛にいただきましたご質問の要約です。
○ご質問 他の内部ブロック図に勝手にportが追加されてしまう現象が発生しています。 1. ブロック図1にblock要素1~4を配置 2. 内部ブロック図1にblock2~4要素を配置し、portを追加・portを要素として表示 3. 内部ブロック図2にblock2~4要素を配置し、別のportを追加(portを要素として表示しない) 4. 内部ブロック図1を見るとportsが反映されたりされなかったりする。 ご確認と、対処方法についてご教授お願いいたします。 ○回答 ご指摘頂きました現象を、弊社環境でも確認致しました。 ports 区画を表示した要素があるダイアグラムを表示した後、別のダイアグラムを開いた際に port を要素として表示している同じ要素に ports 区画が追加されてしまうのは、EA本体のバグと思われます。開発元に連絡するように致します。 修正までは、お手数をおかけいたしますが、以下いずれかで対応頂けますようお願いいたします。 ・port を要素として表示しているダイアグラムを閉じて再表示 ・port を要素として表示しているダイアグラムのプロパティで、ports 区画を非表示に設定 |
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» 他の内部ブロック図に勝手にportが追加されてしまう | umesan | 2022-8-10 14:05 |